AMD empilha cache L2 em 3D e mira salto de desempenho
AMD empilha cache L2 em 3D, segundo uma nova patente batizada de Balanced Latency Stacked Cache, que sugere sobrepor camadas de memória para ampliar capacidade sem aumentar a área do silício.
Por que mexer no segundo nível agora?
Desde o sucesso do 3D V-Cache no nível L3 — visto em CPUs como o Ryzen 9 9950X com 64 MB — a AMD acumulou provas de que mais cache reduz gargalos e eleva FPS em jogos e acelera cargas técnicas. Contudo, o L2 permaneceu modesto: 16 MB no mesmo chip. Limitações físicas de designs 2D (mais área, mais calor e latência) sempre barraram saltos maiores nesse nível intermediário.
A patente recém-revelada propõe empilhar pelo menos dois dies de cache L2, formando blocos verticais. Um exemplo esquematizado mostra 512 KB por bloco, totalizando 2 MB por módulo. A expansão pode chegar a 4 MB por núcleo, elevando o total estimado para 24 MB em um processador de doze módulos — 50% acima do topo atual.
Balanced Latency: volume sem sacrificar velocidade
O nome Balanced Latency indica preocupação com o risco clássico do empilhamento: quanto mais camadas, maior a distância elétrica e, portanto, a latência. A AMD afirma na patente que busca “equilíbrio entre densidade e tempo de acesso”, fator crucial para que ganhos de capacidade não se tornem perdas de performance.
Se viabilizado em silício real, o L2 empilhado pode beneficiar cenários que acessam dados intermediários com frequência, como renderização 3D, simulações físicas e inteligência artificial. Analistas lembram, porém, que patentes não garantem produtos: centenas são registradas e apenas parte chega ao mercado.
Imagem: William R
Até agora, a AMD não divulgou cronograma, protótipo ou benchmarks. Caso queira conferir detalhes técnicos, o portal especializado Tom’s Hardware traz a íntegra dos diagramas e reivindicações da patente.
A expansão vertical do cache L2 mostra que a guerra dos gigabytes não se limita mais ao L3. Resta saber quando — e se — veremos a tecnologia em CPUs de linha como Ryzen ou EPYC.
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Crédito da imagem: Hardware.com.br Fonte: Hardware.com.br
